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일/Study

RTL) Synthesis Design Constraint(SDC) 참조 - Object type

by 멜랑멀리 2022. 12. 21.
SMALL

object type :

design, port, cell, pin, net, clock ....

 

 

get_design : {TOP ENCODER REGFILE}

get_cells : {U1 U2 U3 U4}

get_pins : {U1/AIN U1/BIN ... U4/Q[0] U4/Q[1] }

 

port pin net은 서로 상대적인 개념으로 설정시 주의필요. (current design 위치에 따라 port가 pin 이 될수 있음.)

 

 

 

 

 

 

 

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